valid與ready信號(hào)分三種情況：

（1）valid信號(hào)先到達(dá)

主機(jī)valid信號(hào)早早就到了，T2時(shí)刻并沒(méi)有見(jiàn)到接收方的ready信號(hào)。只能在T3時(shí)刻傳輸完成。

協(xié)議規(guī)定在這種情況下，valid信號(hào)一旦置起就不能置低，直到完成握手，至少傳輸一周期數(shù)據(jù)。 協(xié)議另外規(guī)定：發(fā)送方不能通過(guò)等待接收方 READY信號(hào)來(lái)確定置起 VALID 信號(hào)的時(shí)機(jī)。

通俗來(lái)講就是設(shè)計(jì)發(fā)送方邏輯時(shí)，不能將 READY 信號(hào)作為置高 VALID 邏輯的條件，比如將 READY 信號(hào)通過(guò)組合邏輯生成 VALID信號(hào)，但接收方的ready信號(hào)按照協(xié)議可以依賴發(fā)送方的valid信號(hào)。

（2）ready信號(hào)先到達(dá)

ready信號(hào)很自由，可以等待valid信號(hào)到來(lái)之后再做響應(yīng)，也可在valid信號(hào)到來(lái)前就置高，表示接收端已經(jīng)做好準(zhǔn)備。

而且，READY 信號(hào)與 VALID 不同，接收方可以置起 READY 之后發(fā)現(xiàn)：其實(shí)我好像還挺忙，然后置低 READY 信號(hào)。只要此時(shí) VALID信號(hào)沒(méi)有置起，這種操作是完全可以。

（3）tips

AXI總線是全雙工的，全雙工就意味著該總線的讀寫(xiě)通道是分開(kāi)的，互不影響，那就意味著每條通道都是單向傳輸，單向傳輸?shù)耐ǖ谰鸵馕哆@兩端節(jié)點(diǎn)的身份有差距，在AXI總線傳輸中，通道兩端分為Master和Slave，主機(jī)總是發(fā)起讀寫(xiě)請(qǐng)求的一方。

常見(jiàn)主機(jī)有CPU、DMA，而存儲(chǔ)介質(zhì)控制器則是典型的從機(jī)。主機(jī)可能通過(guò)從機(jī)讀取或者寫(xiě)入存儲(chǔ)介質(zhì)。而顯然從機(jī)不可能主動(dòng)向 CPU 寫(xiě)入數(shù)據(jù)。