生成語句(GENERATE)是一種可以建立重復(fù)結(jié)構(gòu)或者是在多個(gè)模塊的表示形式之間進(jìn)行選擇的語句。由于生成語句可以用來產(chǎn)生多個(gè)相同的結(jié)構(gòu),因此使用生成語句就可以避免多段相同結(jié)構(gòu)的VHDL程序的重復(fù)書寫。 生成語句有兩種形式:FOR- GENERATE模式和IF- GENERATE模式。
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