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電子發(fā)燒友網(wǎng)>嵌入式技術(shù)>嵌入式設(shè)計(jì)應(yīng)用>基于CPLD的高速數(shù)據(jù)采集系統(tǒng)的實(shí)現(xiàn)

基于CPLD的高速數(shù)據(jù)采集系統(tǒng)的實(shí)現(xiàn)

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  • 第 1 頁(yè):基于CPLD的高速數(shù)據(jù)采集系統(tǒng)的實(shí)現(xiàn)
  • 第 2 頁(yè):軟件設(shè)計(jì)
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2009-09-15 16:25:2631

基于CPLD的雷達(dá)高度表數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

本文介紹了一種利用CPLD 器件作控制核心,基于SCSI 硬盤的雷達(dá)高度表高速大容量數(shù)據(jù)采集存儲(chǔ)系統(tǒng),分析了系統(tǒng)組成和設(shè)計(jì)思想,著重對(duì)CPLD 實(shí)現(xiàn)的功能做了介紹并給出了代表信號(hào)
2009-09-18 11:09:3011

基于CPLD與單片機(jī)的高速數(shù)據(jù)采集系統(tǒng)

本文針對(duì)新型匝間耐壓測(cè)試儀中需要高速采集數(shù)據(jù)的問題提出了一種結(jié)合CPLD 與單片機(jī)的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)方案。CPLD 產(chǎn)生A/D 芯片的控制時(shí)序以及SRAM 的讀寫控制時(shí)序,單片機(jī)輸
2009-12-23 14:59:5788

高速數(shù)據(jù)采集系統(tǒng)中精確時(shí)標(biāo)的cpld實(shí)現(xiàn)方法

本文介紹一種利用復(fù)雜可編程邏輯器件給高速數(shù)據(jù)采集系統(tǒng)中的采集數(shù)據(jù)貼上精確時(shí)間標(biāo)簽的方法,并利用MAX PLUSⅡ開發(fā)環(huán)境驗(yàn)證設(shè)計(jì)方案的正確性。此設(shè)計(jì)方案已經(jīng)成功地應(yīng)用到自
2009-12-31 17:03:2919

基于CPLD的雷達(dá)高度表高速大容量數(shù)據(jù)采集存儲(chǔ)系統(tǒng)設(shè)計(jì)

基于CPLD 的雷達(dá)高度表高速大容量數(shù)據(jù)采集存儲(chǔ)系統(tǒng)設(shè)計(jì)作者:李貴新 袁嗣杰 轉(zhuǎn)貼自:微計(jì)算機(jī)信息摘 要:本文介紹了一種利用CPLD 器件作控制核心,基于SCSI 硬盤的雷達(dá)高
2010-01-27 14:18:2622

基于VC++ 6.0的高速串口通信數(shù)據(jù)采集系統(tǒng)

在VC++6.0中利用MSComm控件實(shí)現(xiàn)串口通信時(shí)實(shí)時(shí)性較差,系統(tǒng)資源利用不足,無(wú)法滿足高速串口數(shù)據(jù)采集軟件的編程要求.針對(duì)高速串口數(shù)據(jù)采集軟件的設(shè)計(jì)要求,提出了基于多線程技術(shù)和自
2010-03-02 14:28:41100

雷達(dá)接收機(jī)多通道高速數(shù)據(jù)采集系統(tǒng)

介紹了一種用于雷達(dá)接收機(jī)的多通道高速數(shù)據(jù)采集系統(tǒng)。該系統(tǒng)以計(jì)算機(jī)為采集主控單元,兼容多種格式的數(shù)據(jù),可以實(shí)現(xiàn)多通道的循環(huán)采集系統(tǒng)采集單元由可編程邏輯器件實(shí)現(xiàn)
2010-07-16 15:12:4426

換體DMA高速數(shù)據(jù)采集電路的CPLD實(shí)現(xiàn)

換體DMA高速數(shù)據(jù)采集電路的CPLD實(shí)現(xiàn) 介紹了換體DMA高速數(shù)據(jù)采集電路原理及其CPLD實(shí)現(xiàn)。用CPLD設(shè)計(jì)雙端口RAM緩存、控制譯碼、時(shí)序邏輯電路,很好地解決了電路元件所占體積
2009-03-28 15:09:18666

CPLD在多路高速同步數(shù)據(jù)采集系統(tǒng)中的應(yīng)用

CPLD在多路高速同步數(shù)據(jù)采集系統(tǒng)中的應(yīng)用 CPLD(Complex Programmable Logic Device,復(fù)雜可編程邏輯器件)是在傳統(tǒng)的PAL、GAL基礎(chǔ)上發(fā)展而來的,具有多種工作方式
2009-03-28 16:49:00767

基于ARM和CPLD高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

數(shù)據(jù)采集系統(tǒng)是通過采樣電路將輸入的模擬信號(hào)轉(zhuǎn)換成離散信號(hào),并送入CPU、MCU或DSP進(jìn)行處理。現(xiàn)在流行的基于PCI總線設(shè)計(jì)的采集卡是數(shù)據(jù)采集系統(tǒng)的主流,其優(yōu)點(diǎn)是可以利用PCI
2009-04-19 10:52:31817

利用CPLD實(shí)現(xiàn)多路數(shù)據(jù)采集

設(shè)計(jì)了以CPLD為核心處理芯片的多路數(shù)據(jù)采集系統(tǒng),整個(gè)數(shù)據(jù)采集系統(tǒng)實(shí)現(xiàn)最大采集頻率為800kHz,通道數(shù)為48路的模擬信號(hào)的采集。系統(tǒng)中采用了TI公司最新推出的高速低功耗A/D
2009-05-05 20:04:021666

基于CPLD和FIFO的多通道高速數(shù)據(jù)采集系統(tǒng)的研究

介紹了一種基于CPLD(復(fù)雜可編程邏輯器件)和FIFO(先入先出存儲(chǔ)器)的多通道高速A/D數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)方法,并給出了這種數(shù)據(jù)采集方法的硬件原理電路和主要的軟件設(shè)計(jì)思路
2009-05-05 20:50:091651

CPLD在遠(yuǎn)程多路數(shù)據(jù)采集系統(tǒng)中的應(yīng)用

摘要: 采用VHDL語(yǔ)言和圖形輸入設(shè)計(jì)方法,給出了用CPLD在遠(yuǎn)程多路數(shù)據(jù)采集系統(tǒng)實(shí)現(xiàn)地址譯碼、串口擴(kuò)展、模塊測(cè)試、模數(shù)轉(zhuǎn)換以及高位數(shù)據(jù)處理等功能的具體方
2009-06-20 14:52:11525

換體DMA高速數(shù)據(jù)采集電路原理及其CPLD實(shí)現(xiàn)

摘要:介紹了換體DMA高速數(shù)據(jù)采集電路原理及其CPLD實(shí)現(xiàn)。用CPLD設(shè)計(jì)雙端口RAM緩存、控制譯碼、時(shí)序邏輯電路,很好地解決了電路元件所占體積大、電路復(fù)雜、不能實(shí)現(xiàn)在線
2009-06-20 15:12:07878

高速數(shù)據(jù)采集系統(tǒng)中精確時(shí)標(biāo)的CPLD實(shí)現(xiàn)方法

高速數(shù)據(jù)采集系統(tǒng)中精確時(shí)標(biāo)的CPLD實(shí)現(xiàn)方法 本文介紹一種利用復(fù)雜可編程邏輯器件給高速數(shù)據(jù)采集系統(tǒng)中的采集數(shù)據(jù)貼上精確時(shí)間標(biāo)簽的方法,并
2009-07-20 12:42:23609

高速USB數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

高速USB數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì) 在圖像處理、瞬態(tài)信號(hào)測(cè)量等一些高速、高精度的應(yīng)用中,需要進(jìn)行高速數(shù)據(jù)采集。USB 2.0接口以其高速率等優(yōu)點(diǎn)漸有取
2009-09-26 18:05:46677

基于CPLD和嵌入式系統(tǒng)高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

基于CPLD和嵌入式系統(tǒng)高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn) 介紹一種基于CPLD和嵌入式系統(tǒng)高速數(shù)據(jù)采集系統(tǒng),并詳細(xì)闡述了系統(tǒng)的結(jié)構(gòu)和軟硬件的實(shí)
2009-10-15 23:46:59616

基于A/D和DSP的高速數(shù)據(jù)采集技術(shù)

基于A/D和DSP的高速數(shù)據(jù)采集技術(shù) 中頻信號(hào)分為和差兩路,高速A/D與DSP組成的數(shù)據(jù)采集系統(tǒng)要分別對(duì)這兩路信號(hào)進(jìn)行采集。對(duì)于兩路數(shù)據(jù)采集電路,A/
2009-10-17 10:17:411201

基于單片機(jī)和CPLD實(shí)時(shí)數(shù)據(jù)采集顯示系統(tǒng)設(shè)計(jì)

基于單片機(jī)和CPLD實(shí)時(shí)數(shù)據(jù)采集顯示系統(tǒng)設(shè)計(jì) 1 引言    數(shù)據(jù)采集是分析模擬信號(hào)量數(shù)據(jù)的有效方法。而實(shí)時(shí)顯示數(shù)據(jù)是自動(dòng)化檢測(cè)系統(tǒng)的現(xiàn)實(shí)需求。在測(cè)
2009-12-22 17:31:021739

基于CPLD/FPGA高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

基于CPLD/FPGA高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì) 0 引 言    傳統(tǒng)的數(shù)據(jù)采集系統(tǒng)一般采用單片機(jī),系統(tǒng)大多通過PCI總線完成數(shù)據(jù)的傳輸。其缺點(diǎn)是數(shù)學(xué)運(yùn)算能力差;
2010-01-27 09:35:01508

基于雙端口RAM的高速數(shù)據(jù)采集系統(tǒng)

文章給出了一種基于雙端口 SRAM 技術(shù)的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)。采用將高速雙端口SRAM 映射為主機(jī)內(nèi)存并構(gòu)造成環(huán)狀緩沖區(qū)的方法,實(shí)現(xiàn)高速ADC數(shù)據(jù)流實(shí)時(shí)采集與主機(jī)處理的并行操
2011-07-13 17:59:3199

單片機(jī)系統(tǒng)高速數(shù)據(jù)采集實(shí)現(xiàn)

介紹一種單片機(jī)系統(tǒng)高速數(shù)據(jù)采集實(shí)現(xiàn)方法,在單片機(jī)與高速A/D轉(zhuǎn)換器之間以靜態(tài)存儲(chǔ)器作緩沖器,采用A/D轉(zhuǎn)換器直接寫存儲(chǔ)器的方式提高采樣頻率,實(shí)現(xiàn)高速數(shù)據(jù)采集。并給出了設(shè)
2011-07-18 16:59:08190

高速數(shù)據(jù)采集系統(tǒng)CPLD的應(yīng)用

CPLD高速數(shù)據(jù)采集系統(tǒng)中的應(yīng)用! 介紹了高速數(shù)據(jù)采集系統(tǒng)的整體框架分析了其中的通用部分CPLD系列產(chǎn)品的特點(diǎn)及其開發(fā)軟件.CPLD根據(jù)高速數(shù)據(jù)采集系統(tǒng)的需要VHDL語(yǔ)言的形式,介紹了由
2011-12-17 00:12:0026

5 Gsps高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

以某高速實(shí)時(shí)頻譜儀為應(yīng)用背景,論述了5 Gsps采樣率的高速數(shù)據(jù)采集系統(tǒng)的構(gòu)成和設(shè)計(jì)要點(diǎn),著重分析了采集系統(tǒng)的關(guān)鍵部分高速ADC(analog to digital,模數(shù)轉(zhuǎn)換器)的設(shè)計(jì)、系統(tǒng)采樣時(shí)
2012-02-08 11:11:4418

基于CPLD的線陣CCD數(shù)據(jù)采集系統(tǒng)的開發(fā)

本文結(jié)合實(shí)際應(yīng)用需要,設(shè)計(jì)了基于復(fù)雜可編程邏輯器件(CPLD)的線陣CCD數(shù)據(jù)采集系統(tǒng)。著重介紹了數(shù)據(jù)采集的特點(diǎn)及該系統(tǒng)軟、硬件設(shè)計(jì)和最后的性能評(píng)價(jià)。
2012-05-14 09:53:411133

基于CPLD多通道編碼器數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

  本文提出了采用Xilinx公司生產(chǎn)的CPLD來對(duì)多通道旋轉(zhuǎn)編碼器進(jìn)行數(shù)據(jù)采集的方法,著重介紹了系統(tǒng)的軟硬件設(shè)計(jì)和驅(qū)動(dòng)程序開發(fā),以及實(shí)際應(yīng)用情況,得出了用CPLD技術(shù)為多通道編碼器
2012-07-11 10:36:311224

高速大容量數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

高速大容量數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn),下來看看
2016-05-10 11:24:3314

高速數(shù)據(jù)采集系統(tǒng)中的FPGA的設(shè)計(jì)

高速數(shù)據(jù)采集系統(tǒng)中的FPGA的設(shè)計(jì),下來看看
2016-05-10 11:24:3315

基于FPGA的高速數(shù)據(jù)采集硬件系統(tǒng)設(shè)計(jì)

基于FPGA的高速數(shù)據(jù)采集硬件系統(tǒng)設(shè)計(jì).
2016-05-10 17:06:4043

基于FPGA的高速數(shù)據(jù)采集系統(tǒng)接口設(shè)計(jì)

基于FPGA的高速數(shù)據(jù)采集系統(tǒng)接口設(shè)計(jì).
2016-05-10 17:06:4027

基于FPGA的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

基于FPGA的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì),下來看看
2016-05-10 17:06:4019

基于FPGA的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)_楊江濤

基于FPGA的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì),用ad芯片和sdram構(gòu)成高速數(shù)據(jù)采集系統(tǒng)。
2016-05-17 09:49:5135

六通道高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

六通道高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)
2017-01-17 19:54:2411

基于PXI架構(gòu)的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)_黃宇

基于PXI架構(gòu)的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)_黃宇
2017-02-07 15:17:366

單片機(jī)高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)_張俊梅

單片機(jī)高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)_張俊梅
2017-03-19 11:28:162

基于CPLD高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)_鮮果

基于CPLD高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)_鮮果
2017-03-19 11:45:233

一種便攜式高速數(shù)據(jù)采集器的研究實(shí)現(xiàn)_張珂

一種便攜式高速數(shù)據(jù)采集器的研究實(shí)現(xiàn)_張珂
2017-03-15 09:08:560

高速高精度的數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

設(shè)計(jì)了基于FPGA與ARM 芯片的數(shù)據(jù)采集系統(tǒng),F(xiàn)PGA 負(fù)責(zé)控制A/D轉(zhuǎn)換器,保證了采樣精度與處理速度,ARM負(fù)責(zé)邏輯控制及與上位機(jī)交互的實(shí)現(xiàn),并將采集到的數(shù)據(jù)通過USB高速上傳至主機(jī)進(jìn)行實(shí)時(shí)處理。對(duì)模擬數(shù)據(jù)采集的測(cè)試結(jié)果達(dá)到了較高的采樣精度和速度,驗(yàn)證了整個(gè)系統(tǒng)高速性和可行性。
2017-11-18 12:47:104154

高速數(shù)據(jù)采集記錄系統(tǒng)

2018年8月,西安慕雷電子發(fā)布了全球頂級(jí)高速數(shù)據(jù)采集記錄存儲(chǔ)系統(tǒng),采樣率高達(dá)4GSPS,分辨率12bit,模擬帶寬2GHZ,記錄存儲(chǔ)帶寬高達(dá)6GB/S!西安慕雷電子供應(yīng)全球頂級(jí)高速數(shù)據(jù)采集卡及超寬
2018-11-13 21:21:34486

使用PCI總線設(shè)計(jì)高速數(shù)據(jù)采集系統(tǒng)的資料說明

本文詳細(xì)介紹了一種基于PCI 總線的高速數(shù)據(jù)采集系統(tǒng)的原理、組成和功能以及在Windows2000 環(huán)境下進(jìn)行數(shù)據(jù)采集和存儲(chǔ)的方法。該系統(tǒng)用于某型號(hào)衛(wèi)星下行的高速數(shù)據(jù)采集。系統(tǒng)設(shè)計(jì)與技術(shù)的通用性可應(yīng)用于其它類似的高速數(shù)據(jù)采集與處理系統(tǒng)中。
2019-11-27 16:19:004

如何使用AVR和CPLD實(shí)現(xiàn)高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

為了提高數(shù)據(jù)采集卡的速度,同時(shí)降低成本,設(shè)計(jì)一種并行數(shù)據(jù)采集系統(tǒng),要求并行采集速度大于10 Mb/s。整個(gè)系統(tǒng)由AVR與CPLD控制實(shí)現(xiàn),通過MAXl308完成模數(shù)轉(zhuǎn)換,并設(shè)計(jì)搭建了其外圍電路。采用
2020-07-20 17:17:0211

基于PIC總線的高速數(shù)據(jù)采集系統(tǒng)

本文詳細(xì)介紹了一種基于 PCI 總線的高速數(shù)據(jù)采集系統(tǒng)的原理、組成和功能以及在 Windows 2000 環(huán)境下進(jìn)行數(shù)據(jù)采集和存儲(chǔ)的方法。該系統(tǒng)用于某型號(hào)衛(wèi)星下行的高速數(shù)據(jù)采集。系統(tǒng)設(shè)計(jì)與技術(shù)的通用性可應(yīng)用于其它類似的高速數(shù)據(jù)采集與處理系統(tǒng)中。
2021-04-14 14:29:3013

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