電子發(fā)燒友網(wǎng)核心提示： 根據(jù)ALTERA官方FAE（現(xiàn)場(chǎng)應(yīng)用工程師）的強(qiáng)烈建議，請(qǐng)注意不要隨意帶電插拔JTAG下載接口，否則會(huì)損壞FPGA芯片的JTAG口信號(hào)管腳。 現(xiàn)象： 在排除了下載線的問(wèn)題
2012-09-05 09:00:42
12784 ARM系列處理器正是通過(guò)JTAG 接口使用內(nèi)部集成的ICE 功能, 并采用這種方式實(shí)現(xiàn)在線調(diào)試。此外CPLD、FPGA 等器件大多都可以使用JTAG 接口實(shí)現(xiàn)在線編程或下載。因此,JTAG 接口已經(jīng)成為復(fù)雜芯片系統(tǒng)的必備接口, 在芯片測(cè)試、調(diào)試及實(shí)現(xiàn)其他特殊功能方面發(fā)揮著重要作用。
2018-10-16 08:11:005801 
調(diào)試，提示Incorrect clock value。按照網(wǎng)上的方法，已經(jīng)試過(guò)下面的方法了：1.JTAG測(cè)了，對(duì)地和對(duì)電源，沒(méi)有短路；2.FPGA底部焊盤焊接3.燒寫器使用的是USB Blaster，用其他燒寫器也試過(guò)，不通各位大神，給支支招
2015-10-14 16:00:22
可編程邏輯（FPGA）與硬核處理器（HPS）之間互聯(lián)的結(jié)構(gòu)
2021-04-02 06:03:40
在線調(diào)試方式大都是通過(guò)FPGA器件引出的JTAG接口，同時(shí)使用了一些FPGA片內(nèi)固有的邏輯、存儲(chǔ)器或布線資源就能夠?qū)崿F(xiàn)的。這些調(diào)試功能通常也只需要隨著用戶設(shè)計(jì)所生產(chǎn)的配置文件一同下載到目標(biāo)FPGA器件中
2015-09-02 18:39:49
下載配置與調(diào)試接口電路設(shè)計(jì)FPGA是SRAM型結(jié)構(gòu)，本身并不能固化程序。因此FPGA需要一片F(xiàn)lash結(jié)構(gòu)的配置芯片來(lái)存儲(chǔ)邏輯配置信息，用于進(jìn)行上電配置。以Altera公司的FPGA為例，配置芯片
2019-06-11 05:00:07
后，將電路板上電運(yùn)行。然后把下載電纜接到JTAG接口上，在主機(jī)中運(yùn)行Quartus II軟件，并打開(kāi)Programmer編程器，單擊其中的“Auto Detect”按鈕進(jìn)行FPGA下載鏈路自動(dòng)檢測(cè)。若能正確檢測(cè)到FPGA，說(shuō)明配置電路是正確連接的。
2012-08-12 11:52:54
設(shè)計(jì)和制造技術(shù)的快速發(fā)展，JTAG越來(lái)越多的被用于電路的邊界掃描測(cè)試和可編程芯片的在線系統(tǒng)編程。（特權(quán)同學(xué)，版權(quán)所有）FPGA器件都支持JTAG進(jìn)行在線配置，JTAG邊界掃描的基本原理如圖3.7所示
2019-01-30 02:34:52
`JTAG電路設(shè)計(jì)規(guī)范`
2012-08-20 21:50:52
電路設(shè)計(jì)[FPGA]設(shè)計(jì)經(jīng)驗(yàn)
2012-05-23 19:49:45
電路設(shè)計(jì)[FPGA]設(shè)計(jì)經(jīng)驗(yàn)
2012-08-20 15:37:36
電路設(shè)計(jì)[FPGA]設(shè)計(jì)經(jīng)驗(yàn)
2019-01-03 14:19:28
嗨，我附上了JTAG鏈設(shè)計(jì)結(jié)構(gòu)。請(qǐng)看一下。我想在單JTAG鏈中連接CPLD和FPGA。但是，在我的CPLD中，VCCAUX電壓網(wǎng)是1.8V_CPLD而FPGA Bank-0（VCCO_0）電壓網(wǎng)
2020-05-29 14:17:04
接收端鏈路均衡測(cè)試（Rx LEQ）進(jìn)入環(huán)回模式進(jìn)行誤碼率測(cè)試
2020-12-02 06:49:35
以下 JTAG 連接錯(cuò)誤。
錯(cuò)誤：連接失敗。
無(wú)法正確配置 JTAG 鏈（CCSProtocolPlugin）
錯(cuò)誤：連接失敗。
2023-04-23 07:25:01
各位大神，小弟做FPGA不久，最近設(shè)計(jì)了一個(gè)XC3S1500的FPGA板子，經(jīng)測(cè)試電源供電沒(méi)問(wèn)題，但是JTAG鏈路建立不起來(lái)，初步懷疑是FPGA芯片和配置芯片(XCF08P)的VCCO不一致
2013-04-03 16:30:12
原諒我記憶力不好。。?；撕镁门靼椎臇|西才十個(gè)小時(shí)不到就忘記了，所以趁現(xiàn)在記得趕緊記錄下來(lái)。本文內(nèi)容：重建de1-soc中HPS-FPGA工程。 PS：原工程在http
2018-07-03 08:10:25
的FPGA或ARM處理器都有一些差異，但是同時(shí)兩者又有緊密的聯(lián)系。AC501-SoC開(kāi)發(fā)板上的JTAG鏈同時(shí)連接了FPGA和HPS。使用時(shí)，僅需一個(gè)JTAG鏈路，就能同時(shí)調(diào)試FPGA和HPS。FPGA
2020-02-25 18:40:45
本文由FPGA愛(ài)好者小梅哥編寫，未經(jīng)作者許可，本文僅允許網(wǎng)絡(luò)論壇復(fù)制轉(zhuǎn)載，且轉(zhuǎn)載時(shí)請(qǐng)標(biāo)明原作者。Qsys系統(tǒng)和Linux應(yīng)用程序之間通過(guò)一個(gè)名為hps_0.h的文件交互硬件信息，例如總線上添加
2020-02-16 18:41:59
循環(huán)以從閃存配置FPGA之后，兩個(gè)JTAG工具都無(wú)法看到JTAG鏈。“Initialize Chain”產(chǎn)生通用的帶鏈錯(cuò)誤問(wèn)題，同時(shí)加載匹配的項(xiàng)目文件并嘗試對(duì)flash進(jìn)行編程會(huì)產(chǎn)生不匹配的ID錯(cuò)誤
2019-05-24 14:11:46
由于Quartus?II15.0 Update 2及更早版本中的問(wèn)題，用于將數(shù)據(jù)從HPS EMAC內(nèi)核發(fā)送到FPGA內(nèi)核的時(shí)鐘缺少時(shí)鐘分配。因此，這些HPS EMAC到FPGA路徑將不會(huì)進(jìn)行時(shí)序分析。
2018-07-27 14:27:56
鏈路預(yù)算表用于計(jì)算Maxim工業(yè)、科學(xué)與醫(yī)療無(wú)線頻段(ISM-RF)產(chǎn)品(Tx、Rx、TRx)的鏈路性能，估算特定的射頻電路在幾種環(huán)境下的通信覆蓋范圍和鏈路裕量。該Excel?表格還可用于估算100MHz至10GHz載頻范圍的其它射頻系統(tǒng)的鏈路裕量。
2019-08-22 07:00:30
收到一條錯(cuò)誤消息，指出JTAG電纜已拔下。FLASH可以自己編程而無(wú)需掃描鏈中的FPGA嗎？如果是這樣，我需要設(shè)置IMPACT軟件的特殊設(shè)置嗎？我該怎么做才能調(diào)試問(wèn)題？謝謝！
2020-05-28 13:42:00
）。使用新PCB我遇到了以下問(wèn)題：1.即使鏈中有2個(gè)器件（Flash和FPGA），JTAG也只檢測(cè)FPGA。2.我可以選擇修改JTAG鏈。這次我制作了硬件，使JTAG鏈中只有閃存?，F(xiàn)在JTAG檢測(cè)到閃光燈并且
2020-06-10 10:20:24
通過(guò)FPGA器件本身間接的將數(shù)據(jù)燒錄到Flash等外部配置芯片中。另一種下載配置是將配置數(shù)據(jù)流直接下載到配置芯片中。由于JTAG方式靈活多用，尤其是在線調(diào)試非?？焖俦憷?，因此我們的FPGA核心板電路中就
2016-08-10 17:03:57
，希望在訪問(wèn)并發(fā)上能支持較高的能力，同時(shí)可以控制精準(zhǔn)度、實(shí)時(shí)調(diào)控、TPS直接壓測(cè)模式，甚至是大脈沖； 3、希望基于PTS完成全鏈路壓測(cè)，需要PTS能方便快捷的提供全局流量的模擬和構(gòu)造能力； 4、對(duì)高可用
2018-01-30 14:13:04
我使用兩個(gè)獨(dú)立的位文件在JTAG鏈中配置了兩個(gè)FPGA。在這種情況下，完成總是設(shè)置為低，盡管影響說(shuō)“程序成功”。我將完成引腳連接到LED，在那里我看不到LED發(fā)光。附加了日志文件。請(qǐng)?zhí)岢鼋鉀Q方案
2019-05-22 10:32:24
大家好，我們將使用的 MCU 屬于 STM32U5 系列。調(diào)試探針將是 SEGGER J-Link Base。多個(gè) MCU 使用典型的 JTAG 菊花鏈連接通過(guò) JTAG 連接
2022-12-20 07:08:46
你好，我在JTAG鏈中有兩個(gè)器件 - xc7k160t和一些IR長(zhǎng)度= 30的定制ASIC器件。我有以下情況：1.在Vivado 2016.4中 - 當(dāng)ASIC處于RESET狀態(tài)時(shí)，我看到JTAG鏈
2020-06-05 15:39:32
海， 我的電路板由2個(gè)Kintex-7 fpga和兩個(gè)獨(dú)立的BPI閃光燈（微米級(jí)閃光燈）組成。如何使用單JTAG連接器（菊花鏈）progaram 2 fpga？theertha
2020-05-29 13:47:54
大家好，如果兩個(gè)FPGA連接在單個(gè)JTAG鏈中。那么DONE和INIT引腳的推薦連接是什么。兩個(gè)FPGA的INIT引腳（也是DONE引腳）是應(yīng)該連接在一起還是應(yīng)該分開(kāi)？Xilinx是否為此推薦了任何
2019-01-10 11:00:55
接入調(diào)試端口，而不會(huì)干擾JTAG鏈路的邏輯。在微處理器碼調(diào)試期間獲得微處理器JTAG端口的全部控制，而能夠用JTAG調(diào)試工具。假如沒(méi)有測(cè)試工具連接到JTAG和編程接頭，則固件工程師除希望有到微處理器的鏈
2019-05-05 09:29:32
我有與FPGA初始化有關(guān)的問(wèn)題，LED INIT改變狀態(tài)RED和GREEN。因?yàn)槲覠o(wú)法配置JTAG鏈.....
2019-09-25 08:17:32
我自己的位文件下載到v5中，但是很失望地發(fā)現(xiàn)jtag鏈無(wú)法讀取FPGA的器件ID。 swothes sw6和sw3設(shè)置為11001010和00010101。和其他設(shè)置我需要配置？非常感謝 ！
2019-08-16 09:13:46
多個(gè) DSP、FPGA、CPLD 和其他邏輯器件，使得它們可以通過(guò)單個(gè) JTAG 連接器進(jìn)行控制。菊花鏈常用于具有多個(gè) JTAG 器件的電路板，它可以將 TDI 和 TDO 引腳連接在一起以形成一個(gè)
2018-10-11 11:16:23
多片fpga組成jtag鏈的時(shí)候如何加載？
2023-08-11 09:10:26
移植到FPGA上，只有一個(gè)JTAG接口。再進(jìn)行MCU調(diào)試的話，是采用其他擴(kuò)展引腳定位為MCU的JTAG調(diào)試？還是使用FPGA的uart串口接口了？
2023-08-11 13:41:00
供了相應(yīng)的Tcl程序包。有了這套工具，使用sld_virtual_jtag 和相應(yīng)的Tcl命令，我們就可以構(gòu)建自己的虛擬JTAG鏈路，并進(jìn)行自定義的JTAG調(diào)試了。 一、 相關(guān)文件 后面的鏈接
2018-07-03 00:53:26
方法是通過(guò)發(fā)送Message，即DSP端程序執(zhí)行時(shí)將日志信息以message方式發(fā)送到GPP，再由GPP來(lái)顯示。
4.另外一種方法是通過(guò)仿真器來(lái)調(diào)試DSP端程序，但是能不能同時(shí)調(diào)試GPP端程序呢，請(qǐng)各位達(dá)人給出一點(diǎn)建議，謝謝。
2018-06-21 20:16:33
本帖最后由 一只耳朵怪 于 2018-6-21 15:55 編輯
JTAG調(diào)試的下載器選用TI有配套的么？JTAG口在電路設(shè)計(jì)上可以如FPGA的JTAG口一樣設(shè)計(jì)為2.54間距的排針么
2018-06-21 04:41:08
本帖最后由 一只耳朵怪 于 2018-6-14 08:47 編輯
以前都是使用CCS3.3來(lái)進(jìn)行調(diào)試的?，F(xiàn)在由于想用新的片子，如F28377，所以準(zhǔn)備升級(jí)下調(diào)試軟件平臺(tái)。先試試CCS4.12，但是發(fā)現(xiàn)不會(huì)設(shè)置同時(shí)調(diào)試兩個(gè)片子。有沒(méi)有知道的，來(lái)指導(dǎo)下，謝謝了。
2018-06-13 10:38:00
JTAG調(diào)試原理（推薦）:ARM JTAG 調(diào)試原理
2009-05-27 08:59:49
21 JTAG調(diào)試原理（推薦）:溫度循環(huán)監(jiān)測(cè)儀
2009-05-27 10:38:5954 JTAG調(diào)試原理（推薦）:這篇文章主要介紹ARM JTAG調(diào)試的基本原理?；镜膬?nèi)容包括了TAP (TEST ACCESS PORT) 和BOUNDARY-SCAN ARCHITECTURE的介紹，在此基礎(chǔ)上，結(jié)合ARM7TDMI詳細(xì)介紹了的JTAG調(diào)試原
2009-05-27 10:44:50147 這篇文章主要介紹ARM JTAG調(diào)試的基本原理。基本的內(nèi)容包括了TAP (TEST ACCESS PORT) 和BOUNDARY-SCAN ARCHITECTURE的介紹，在此基礎(chǔ)上，結(jié)合ARM7TDMI詳細(xì)介紹了的JTAG調(diào)試原理。這篇文章主要是
2009-07-14 23:19:4982 JTAG電路設(shè)計(jì)規(guī)范:本技術(shù)設(shè)計(jì)規(guī)范根據(jù)國(guó)家標(biāo)準(zhǔn)和原郵電部標(biāo)準(zhǔn)以及國(guó)際標(biāo)準(zhǔn)IEEE STD 1149.1 系列標(biāo)準(zhǔn)編制而成。
目前，使用的芯片中越來(lái)越多的CPU、EPLD、FPGA、DSP 以及一些
2009-09-19 07:40:5793 嵌入式JTAG調(diào)試方法步驟
嵌入式系統(tǒng)JTAG調(diào)試步驟1． 將PC與調(diào)試器Multi-ICE用并口連接；調(diào)試器與開(kāi)發(fā)板用14或20針的JTAG線連接。2． 依次打開(kāi)調(diào)試器
2010-03-01 16:24:2034 目前通訊電子產(chǎn)品的芯片、單板、系統(tǒng)的復(fù)雜度不斷提高，物理尺寸卻在不斷縮小，JTAG電路的設(shè)計(jì)也隨之成為關(guān)系到單板可測(cè)性、穩(wěn)定性和可靠性的重要因素。 JTAG測(cè)試接口在集成
2010-08-02 16:42:070 JTAG技術(shù)是一種嵌入式調(diào)試技術(shù)，芯片內(nèi)部封裝了專門的測(cè)試電路TAP（測(cè)試訪問(wèn)口），通過(guò)專用的JTAG測(cè)試工具對(duì)內(nèi)部節(jié)點(diǎn)進(jìn)行測(cè)試和控制，目前大多數(shù)ARM器件支持JTAG
2008-08-24 13:10:398144 
JTAG調(diào)試快速入門
提要：本文介紹 AVR Studio Debug：調(diào)試運(yùn)行方式及QuickWatch實(shí)時(shí)查看變量的數(shù)值。
以下的degug方式，英文版來(lái)自 AVR St
2008-10-31 21:58:102055
集成極-基極同時(shí)調(diào)幅電路
2009-03-19 20:17:30649 
正負(fù)電壓可同時(shí)調(diào)節(jié)的穩(wěn)壓電路圖
2009-05-13 21:34:433366 
JTAG調(diào)試接口電路
注：VPUMP和VJTAG需要接3.
2010-03-17 09:25:562554 
基于JTAG仿真器的調(diào)試是目前ARM開(kāi)發(fā)中采用最多的一種方式。大多數(shù)ARM設(shè)計(jì)采用了片上JTAG接口，并將其作為測(cè)試、調(diào)試方法的重要組成。
JTAG仿真器通過(guò)ARM芯片的JTAG邊界掃描
2010-06-30 15:20:033001 
本內(nèi)容提供了ARM JTAG調(diào)試頭和Altera下載線合并電路 詳細(xì)列舉了電路原理圖
2011-03-31 17:19:22209 隨著 FPGA 的設(shè)計(jì)速度、尺寸和復(fù)雜度明顯增長(zhǎng)，使得整個(gè)設(shè)計(jì)流程中的實(shí)時(shí)驗(yàn)證和調(diào)試成為當(dāng)前FPGA 系統(tǒng)的關(guān)鍵部分。獲得FPGA 內(nèi)部信號(hào)有限、FPGA 封裝和印刷電路板(PCB)電氣噪聲，這一
2011-06-10 15:42:2828 ARM處理器采用一種基于JTAG的ARM的內(nèi)核調(diào)試通道，它具有典型的ICE功能，基于ARM的包含有Embedded ICE(嵌入式在線仿真器)模塊的系統(tǒng)芯片通過(guò)JTAG端口與主計(jì)算機(jī)連接。
2011-08-16 09:51:082370 
這篇文章主要介紹ARM JTAG調(diào)試的基本原理。基本的內(nèi)容包括了TAP (TEST ACCESS PORT) 和BOUNDARY-SCAN ARCHITECTURE的介紹，在此基礎(chǔ)上，結(jié)合ARM7TDMI詳細(xì)介紹了的JTAG調(diào)試原理。 這篇文章主要是總結(jié)了
2011-11-15 17:35:390 Altera JTAG下載和調(diào)試接口電路圖如下圖所示：
2012-08-15 14:25:2213966 
電子發(fā)燒友網(wǎng)站提供《H-JTAG調(diào)試軟件下載.exe》資料免費(fèi)下載
2012-12-18 13:15:3457 在調(diào)試FPGA電路時(shí)要遵循必須的原則和技巧，才能降低調(diào)試時(shí)間，防止誤操作損壞電路。通常情況下，參考以下步驟執(zhí)行 FPGA硬件系統(tǒng)的調(diào)試。 1、在焊接硬件電路前，首先要測(cè)試電路板
2013-01-16 11:59:584665 基于FPGA的慣性平臺(tái)測(cè)試保護(hù)電路設(shè)計(jì)..
2016-01-04 17:03:557 IAR+H_JTAG調(diào)試FLASH說(shuō)明及例程。
2016-02-18 15:11:444 ARM JTAG 調(diào)試原理對(duì)于了解jtag結(jié)構(gòu)由很好的幫助。
2016-03-10 14:08:4810 H-JTAG 用戶使用手冊(cè)簡(jiǎn)單介紹了 H-JTAG 和 H-FLASHER 的基本使用和配置，手冊(cè)同時(shí)也提供了一
些簡(jiǎn)單的例子供用戶參考
2016-05-03 15:15:086 電路設(shè)計(jì)[FPGA]設(shè)計(jì)經(jīng)驗(yàn)，有需要的下來(lái)看看
2016-05-20 11:16:3546 基于FPGA的串口通信電路設(shè)計(jì)
2017-01-24 17:30:1333 的橋接的，難道FPGA內(nèi)部有專用的電路去實(shí)現(xiàn)這一功能嗎？ 其實(shí)不是的。FPGA內(nèi)部并沒(méi)有設(shè)計(jì)（預(yù)留）專用的電路去實(shí)現(xiàn)JTAG到Flash的轉(zhuǎn)換，在我們通過(guò)JTAG燒寫Flash時(shí)，電腦其實(shí)是先要預(yù)下載
2017-02-08 02:40:116513 
DSP和FPGA的HDLC協(xié)議通訊電路設(shè)計(jì)
2017-10-19 14:46:117 , FPGA)進(jìn)行遠(yuǎn)端升級(jí)，本文提出了一種基于XVC (Xilinx visual cable)協(xié)議，通過(guò)以太網(wǎng)，利用ARM 微控制器控制FPGA 的JTAG 接口對(duì)其進(jìn)行遠(yuǎn)程更新與調(diào)試的方法。該方案附加電路少，易于拓展，同時(shí)也提高了更新可靠性。
2017-11-16 20:13:0212514 
JTAG（JointTestActionGroup，聯(lián)合測(cè)試行動(dòng)小組）是一種國(guó)際標(biāo)準(zhǔn)測(cè)試協(xié)議，主要用于芯片內(nèi)部測(cè)試及對(duì)系統(tǒng)進(jìn)行仿真、調(diào)試，JTAG技術(shù)是一種嵌入式調(diào)試技術(shù)，它在芯片內(nèi)部封裝了專門
2018-01-11 09:45:5028818 
為了能夠?qū)崿F(xiàn)HPS與FPGA之間的通信接口，衍生出了AXI bridge協(xié)議。AXI bridge協(xié)議能夠處理帶寬適應(yīng)和時(shí)鐘控制，支持HPS與FPGA之間雙向的邏輯和數(shù)據(jù)交互。
2018-05-02 17:30:006627 
如何在預(yù)加載器中調(diào)試HPS SDRAM
2018-06-20 00:44:003023 
JTAG 鏈調(diào)試程序工具
2018-06-20 01:00:003687 
本文檔的主要內(nèi)容詳細(xì)介紹的是FPGA教程之FPGA硬件最小系統(tǒng)設(shè)計(jì)的詳細(xì)資料說(shuō)明包括了：1.FPGA最小系統(tǒng)概念以及硬件系統(tǒng)的構(gòu)成，2.FPGA主芯片電路設(shè)計(jì)，3.JTAG下載與調(diào)試接口，4.高速
2019-04-04 17:18:48101 中國(guó)大學(xué)MOOC
本課程以目前流行的Xilinx 7系列FPGA的開(kāi)發(fā)為主線，全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語(yǔ)言及VIVADO的應(yīng)用，并循序漸進(jìn)地從組合邏輯、時(shí)序邏輯的開(kāi)發(fā)開(kāi)始，深入到FPGA的基礎(chǔ)應(yīng)用、綜合應(yīng)用和進(jìn)階應(yīng)用。
2019-08-06 06:08:003083 產(chǎn)品名稱：Jtag調(diào)試小板
2019-11-13 09:53:102071 
對(duì)Xilinx ZYNQ-SOC處理器的調(diào)試。JTAG-HS3可通過(guò)Xilinx 2x7連接器鏈接到目標(biāo)板上，同時(shí)該產(chǎn)品所有的Xilinx開(kāi)發(fā)工具，包括iMPACT?，ChipScope?和EDK。
2019-11-13 17:12:335009 
本文檔的主要內(nèi)容詳細(xì)介紹的是FPGA的硬件電路設(shè)計(jì)教程和FPGA平臺(tái)資料簡(jiǎn)介包括了：FPGA技術(shù)概述；主流FPGA器件介紹；VIRTEX-5 FPGA電路設(shè)計(jì)；V4LX160 FPGA平臺(tái)介紹；
2020-07-06 18:11:22158 JTAG是Joint Test Action Group的縮寫，是IEEE 1149.1標(biāo)準(zhǔn)。使用JTAG的優(yōu)點(diǎn)：JTAG的建立使得集成電路固定在PCB上，只通過(guò)邊界掃描便可以被測(cè)試。
2020-08-27 14:18:482860 本文檔的主要內(nèi)容詳細(xì)介紹的是FPGA JTAG工具設(shè)計(jì)的教程說(shuō)明。
2020-12-31 17:30:5518 賽靈思公司的FPGA芯片具有IEEE 1149.1/1532協(xié)議所規(guī)定的JTAG接口，只要FPGA上電，不論模式選擇管腳M［1:0］ 的電平，都可用采用該配置模式。JTAG模式不需要額外的掉電
2020-12-31 17:30:5513 開(kāi)發(fā)板（在本文中將其簡(jiǎn)稱為“FPGA開(kāi)發(fā)板”）和專用 JTAG 調(diào)試器（在本文中將其簡(jiǎn)稱為“JTAG 調(diào)試器”）。
2021-03-23 10:00:2841 利用FPGA的在系統(tǒng)下載或重新配置功能，可以在電路設(shè)計(jì)和調(diào)試時(shí)改變整個(gè)電路的硬件邏輯關(guān)系，而不需要改變印制電路板的結(jié)構(gòu)。
2021-05-12 10:46:1025 FPGA CPLD數(shù)字電路設(shè)計(jì)經(jīng)驗(yàn)分享.(電源技術(shù)發(fā)展怎么樣)-FPGA CPLD數(shù)字電路設(shè)計(jì)經(jīng)驗(yàn)分享? ? ? ? ? ? ? ? ? ??
2021-09-18 10:58:0351 使用Jtag Master調(diào)試FPGA程序時(shí)用到tcl語(yǔ)言，通過(guò)編寫tcl腳本，可以實(shí)現(xiàn)對(duì)FPGA的讀寫，為調(diào)試FPGA程序帶來(lái)極大的便利，下面對(duì)FPGA調(diào)試過(guò)程中常用的tcl語(yǔ)法進(jìn)行介紹，并通過(guò)tcl讀FIFO的例子，說(shuō)明tcl在實(shí)際工程中的應(yīng)用。
2022-02-19 19:44:342272 對(duì)FPGA進(jìn)行上板調(diào)試時(shí)，使用最多的是SignalTap，但SignalTap主要用來(lái)抓取信號(hào)時(shí)序，當(dāng)需要發(fā)送信號(hào)到FPGA時(shí)，Jtag Master可以發(fā)揮很好的作用，可以通過(guò)Jtag Master對(duì)FPGA進(jìn)行讀寫測(cè)試
2022-02-16 16:21:361900 
實(shí)用電子電路設(shè)計(jì)與調(diào)試數(shù)字電路教材資料免費(fèi)下載。
2022-04-07 14:46:3826 JTAG鏈調(diào)試器(JTAG Chain Debugger)，隨XJTAG的安裝包一起安裝，是一個(gè)功能強(qiáng)大的工具，旨在幫助您解決JTAG鏈的問(wèn)題。
2023-07-19 14:41:07319 
因?yàn)槟壳败浖南拗疲琑ISCV的邏輯不能同時(shí)共用JTAG，所以如果想要同時(shí)去調(diào)試邏輯和RISCV的話，可以通過(guò)RISCV的soft Jtag來(lái)實(shí)現(xiàn)。soft Jtag就是通過(guò)GPIO來(lái)實(shí)現(xiàn)的軟件
2024-02-23 16:16:12110 
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