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發(fā)視頻基于RS485的數(shù)據(jù)通信協(xié)議的設(shè)計(jì)與實(shí)現(xiàn)
2013-09-16 |
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資料介紹
基于現(xiàn)場(chǎng)可編程門(mén)陣列（FPGA），設(shè)計(jì)了采用RS485標(biāo)準(zhǔn)的數(shù)據(jù)通信協(xié)議。其中，高速信號(hào)接收，采用同步485通信協(xié)議，高速接口包括時(shí)鐘和數(shù)據(jù)兩個(gè)信號(hào)，時(shí)鐘速率3.6864 MHz，利用同步時(shí)鐘上升沿檢測(cè)數(shù)據(jù)。低速信號(hào)接收采用異步485通信協(xié)議，波特率115.2 kbps，每字節(jié)1個(gè)起始位，8個(gè)數(shù)據(jù)位，1個(gè)截止位。針對(duì)高速數(shù)據(jù)接收時(shí)的情況，加入1 MB 容量的靜態(tài)存儲(chǔ)器SRAM作為緩存，保證接收數(shù)據(jù)的可靠性。
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