資料介紹
1 PROTEUS軟件簡(jiǎn)介
PROTEUS是來自英國(guó)公司的工具軟件,在全球廣泛使用。和其它工具相比,這款軟件的最大特點(diǎn)就在于它能夠模擬單片機(jī)??梢灾苯釉诨谠韴D的虛擬原型EDA上編程,并實(shí)現(xiàn)軟件源碼級(jí)的實(shí)時(shí)調(diào)試。還能看到運(yùn)行后輸入輸出的效果。但是現(xiàn)在大家都只注意到PROTEUS對(duì)單片機(jī)的仿真和如何與Keil進(jìn)行關(guān)聯(lián)調(diào)試,其實(shí)PROTEUS還能夠進(jìn)行PLD的電路仿真。
PLD(可編程邏輯器件)是一種數(shù)字集成電路的半成品,在其芯片上按一定排列方式集成了大量的門和觸發(fā)器等基本邏輯元件,使用者可利用某種開發(fā)工具對(duì)其進(jìn)行加工,即按設(shè)計(jì)要求將這些片內(nèi)的元件連接起來,使之完成某個(gè)邏輯電路或系統(tǒng)的功能,成為一個(gè)可在實(shí)際電子系統(tǒng)中使用的專用集成電路。
一般的PLD設(shè)計(jì)軟件只能進(jìn)行PLD芯片的時(shí)序邏輯仿真,而PROTEUS能進(jìn)行PLD的電路仿真,可以模擬設(shè)計(jì)的PLD芯片在電路中實(shí)際運(yùn)行的情況。
我們通過使用GAL16V8設(shè)計(jì)一個(gè)在單片機(jī)系統(tǒng)里常用的三八譯器,然后在PROTEUS中通過觀察GAL16V8中三八譯碼器的輸入與輸出的對(duì)應(yīng)關(guān)系來完成PLD的電路仿真。
2. PLD的設(shè)計(jì)
首先用Protel 99SE完成PLD的設(shè)計(jì)。
完成后的PLD原理圖如下所示:
![PLD的PROTEUS電路仿真](/uploads/allimg/171204/2755807-1G20411151B92.png)
圖1畫好的PLD原理圖這是一個(gè)3-8譯碼器的PLD文件。輸入信號(hào)為目標(biāo)元件的2、3、4三個(gè)腳,輸出信號(hào)為目標(biāo)元件的12-19腳,6-8腳為使能控制端。
Protel 99SE的PLD原理圖的設(shè)計(jì)與普通原理圖相同,但有幾點(diǎn)是需要注意:
生成PLD元理圖后,在原理圖中自動(dòng)加入了兩個(gè)PLD的元件庫(PLD_Devices.lib、PLD_Symbols.lib),PLD的電路圖繪制必需使用這兩個(gè)庫中的元件。
繪制PLD原理圖時(shí),必須放置輸入/輸出端口(輸入:IPAD、輸出:OPAD、輸入/輸出:IOPAD)元件,這些元件所指定的引腳代表著目標(biāo)器件的引腳。
在輸入/輸出端口元件放置好后,必須對(duì)其進(jìn)行編號(hào),還要指定該端口元件所對(duì)應(yīng)連接的目標(biāo)器件的引腳號(hào)。
完成PLD原理圖后,選擇[PLD]/[Compile]進(jìn)行編譯,生成各種格式的文件:
![PLD的PROTEUS電路仿真](/uploads/allimg/171204/2755807-1G204111524507.png)
圖2編譯生成的各種文件打開生成的。jed文件,點(diǎn)擊右鍵,在彈出的窗口中選擇[Export…]項(xiàng),選擇。jed文件的輸出目標(biāo)地址。
至此就完成了PLD文件的設(shè)計(jì)。
PROTEUS是來自英國(guó)公司的工具軟件,在全球廣泛使用。和其它工具相比,這款軟件的最大特點(diǎn)就在于它能夠模擬單片機(jī)??梢灾苯釉诨谠韴D的虛擬原型EDA上編程,并實(shí)現(xiàn)軟件源碼級(jí)的實(shí)時(shí)調(diào)試。還能看到運(yùn)行后輸入輸出的效果。但是現(xiàn)在大家都只注意到PROTEUS對(duì)單片機(jī)的仿真和如何與Keil進(jìn)行關(guān)聯(lián)調(diào)試,其實(shí)PROTEUS還能夠進(jìn)行PLD的電路仿真。
PLD(可編程邏輯器件)是一種數(shù)字集成電路的半成品,在其芯片上按一定排列方式集成了大量的門和觸發(fā)器等基本邏輯元件,使用者可利用某種開發(fā)工具對(duì)其進(jìn)行加工,即按設(shè)計(jì)要求將這些片內(nèi)的元件連接起來,使之完成某個(gè)邏輯電路或系統(tǒng)的功能,成為一個(gè)可在實(shí)際電子系統(tǒng)中使用的專用集成電路。
一般的PLD設(shè)計(jì)軟件只能進(jìn)行PLD芯片的時(shí)序邏輯仿真,而PROTEUS能進(jìn)行PLD的電路仿真,可以模擬設(shè)計(jì)的PLD芯片在電路中實(shí)際運(yùn)行的情況。
我們通過使用GAL16V8設(shè)計(jì)一個(gè)在單片機(jī)系統(tǒng)里常用的三八譯器,然后在PROTEUS中通過觀察GAL16V8中三八譯碼器的輸入與輸出的對(duì)應(yīng)關(guān)系來完成PLD的電路仿真。
2. PLD的設(shè)計(jì)
首先用Protel 99SE完成PLD的設(shè)計(jì)。
完成后的PLD原理圖如下所示:
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圖1畫好的PLD原理圖這是一個(gè)3-8譯碼器的PLD文件。輸入信號(hào)為目標(biāo)元件的2、3、4三個(gè)腳,輸出信號(hào)為目標(biāo)元件的12-19腳,6-8腳為使能控制端。
Protel 99SE的PLD原理圖的設(shè)計(jì)與普通原理圖相同,但有幾點(diǎn)是需要注意:
生成PLD元理圖后,在原理圖中自動(dòng)加入了兩個(gè)PLD的元件庫(PLD_Devices.lib、PLD_Symbols.lib),PLD的電路圖繪制必需使用這兩個(gè)庫中的元件。
繪制PLD原理圖時(shí),必須放置輸入/輸出端口(輸入:IPAD、輸出:OPAD、輸入/輸出:IOPAD)元件,這些元件所指定的引腳代表著目標(biāo)器件的引腳。
在輸入/輸出端口元件放置好后,必須對(duì)其進(jìn)行編號(hào),還要指定該端口元件所對(duì)應(yīng)連接的目標(biāo)器件的引腳號(hào)。
完成PLD原理圖后,選擇[PLD]/[Compile]進(jìn)行編譯,生成各種格式的文件:
![PLD的PROTEUS電路仿真](/uploads/allimg/171204/2755807-1G204111524507.png)
圖2編譯生成的各種文件打開生成的。jed文件,點(diǎn)擊右鍵,在彈出的窗口中選擇[Export…]項(xiàng),選擇。jed文件的輸出目標(biāo)地址。
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