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      電子發(fā)燒友網(wǎng)>電子資料下載>DSP>用Blackfin DSP實現(xiàn)刪余速率為1:4的維特比解碼器

      用Blackfin DSP實現(xiàn)刪余速率為1:4的維特比解碼器

      2010-05-11 | rar | 165 | 次下載 | 3積分

      資料介紹

      用Blackfin DSP實現(xiàn)刪余速率為1:4的維特比解碼器

      維特比算法(VA)是數(shù)字通信領(lǐng)域中常用的糾錯方法。由于功能強大，維特比算法被廣泛應(yīng)用于目前大多數(shù)的數(shù)字通信標準。

      使用維特比算法進行糾錯的系統(tǒng)由發(fā)送端的卷積編碼器和接收端的維特比解碼器(VD)組成。在編碼端，可以選擇將輸入的數(shù)據(jù)流編碼成更高速率的數(shù)據(jù)流，形成所謂的1:2、1:3、1:4等碼率。這意味著，對應(yīng)每個輸入的消息符號(位)分別有2、3或4個編碼后的符號。編碼后的位被映射為1和-1兩個值，分別代表邏輯0和1。這些值再用來調(diào)制發(fā)送信號。

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