在傳統(tǒng)設(shè)計(jì)中，所有計(jì)算機(jī)運(yùn)算（算法邏輯和存儲(chǔ)進(jìn)程） 都參考時(shí)鐘同步執(zhí)行，時(shí)鐘增加了設(shè)計(jì)中的時(shí)序電路數(shù)量。在這個(gè)電池供電設(shè)備大行其道的移動(dòng)時(shí)代，為了節(jié)省每一毫瓦（mW） 的功耗，廠商間展開了殘酷的競(jìng)爭(zhēng)，因此將電路分成多個(gè)電源域并根據(jù)要求關(guān)閉它們，并且在設(shè)計(jì)每個(gè)時(shí)序電路的同時(shí)節(jié)省功耗，這兩點(diǎn)至關(guān)重要。時(shí)序電路（如計(jì)數(shù)器和寄存器） 在現(xiàn)代設(shè)計(jì)中無處不在。本文以約翰遜計(jì)數(shù)器為例介紹了如何采用有效門控時(shí)鐘來設(shè)計(jì)高能效的時(shí)序電路。

　　約翰遜計(jì)數(shù)器系統(tǒng)，可同步提供多種特殊類型的數(shù)據(jù)序列，這對(duì)于大多數(shù)重要應(yīng)用（如D/A 轉(zhuǎn)換器、FSM 和時(shí)鐘分頻器） 來說至關(guān)重要。為支持不同頻率（從MHZ 到GHz） 的模塊，越來越多的IP 集成到片上系統(tǒng)，因此，設(shè)計(jì)中在不同層級(jí)實(shí)施了許多可支持多個(gè)分頻因子的時(shí)鐘分頻器。本文中，我們介紹了一款節(jié)能設(shè)計(jì)，即用帶有門控時(shí)鐘的多級(jí)可編程約翰遜計(jì)數(shù)器系統(tǒng)來取代多個(gè)時(shí)鐘分頻器，該計(jì)數(shù)器可提供8 至任何偶數(shù)值（在本文中為38） 的時(shí)鐘分頻因子。下面，我們將探討實(shí)施細(xì)節(jié)和該技術(shù)的優(yōu)劣。

　典型時(shí)序電路

　　圖1給出的是一款傳統(tǒng)4 位上升沿約翰遜計(jì)數(shù)器。約翰遜計(jì)數(shù)器只不過是修改過的移位寄存器，其最后一個(gè)D 觸發(fā)器的反相輸出作為第一個(gè)D 觸發(fā)器的輸入。所有其他觸發(fā)器將接收上一個(gè)觸發(fā)器所提供的輸出。