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Atium Designer 6中提高的FPGA的設(shè)計(jì)環(huán)境。在本章中將介紹FPGA的設(shè)計(jì)過(guò)程、參數(shù)設(shè)置、仿真及NanoBoard-NB1開(kāi)發(fā)器。
在Altium Designer 6中進(jìn)行FPGA設(shè)計(jì)可以采用：語(yǔ)言設(shè)計(jì)輸入，原理圖符號(hào)設(shè)計(jì)或者混合輸入。這里建議用戶(hù)采用層次化的設(shè)計(jì)方式：底層設(shè)計(jì)，上層例化(調(diào)用)。在底層用語(yǔ)言或原理圖符號(hào)設(shè)計(jì)好一個(gè)個(gè)文件，并將這些文件生成圖表符，上層在原理圖環(huán)境中將這些代表各個(gè)文件的圖標(biāo)符連接起來(lái)，并且可以使用提供的各種免費(fèi)模塊、軟處理器和外設(shè)接口模塊等，來(lái)完成設(shè)計(jì)與測(cè)試。
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