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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的高速硬件防火墻報(bào)文檢測(cè)系統(tǒng)設(shè)計(jì)

      基于FPGA的高速硬件防火墻報(bào)文檢測(cè)系統(tǒng)設(shè)計(jì)

      2009-09-08 | rar | 572 | 次下載 | 5積分

      資料介紹

      在這篇論文中，我們介紹了一個(gè)基于 FPGA 的網(wǎng)絡(luò)報(bào)文處理硬件平臺(tái)并且分析了一種基于硬件的防火墻報(bào)文檢測(cè)系統(tǒng)結(jié)構(gòu)。目前的基于軟件的防火墻計(jì)算量非常大并且不能夠滿(mǎn)足現(xiàn)代網(wǎng)絡(luò)帶寬的需要。而基于硬件的技術(shù)是加速網(wǎng)絡(luò)處理的一個(gè)理想的辦法。文章著重介紹了基于FPGA 的IP 報(bào)文過(guò)濾處理模塊設(shè)計(jì)，它是基于硬件防火墻的核心處理部分。過(guò)濾處理采用關(guān)鍵字匹配策略的重要特征是利用CAM 作為處理單元。CAM 可以在超過(guò)2Gbps 的速度下進(jìn)行線速的入侵檢測(cè)報(bào)文查找。
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