資料介紹
針對(duì)基于軟件仿真片上網(wǎng)絡(luò)NoC(Network on Chip)效率低的問(wèn)題,提出基于FPGA的NoC驗(yàn)證平臺(tái)構(gòu)建方案。該平臺(tái)集成可重用的流量產(chǎn)生器TG(Traffic Generation),流量接收器TR(Traffic Receiver)以及NoC軟件,用于對(duì)NoC原型系統(tǒng)進(jìn)行功能驗(yàn)證和性能評(píng)估。實(shí)際設(shè)計(jì)一個(gè)多核NoC,并用該平臺(tái)對(duì)其進(jìn)行FPGA驗(yàn)證,結(jié)果表明該平臺(tái)的驗(yàn)證速度比軟件仿真提高16000倍以上,并能對(duì)多種不同結(jié)構(gòu)、路由算法、流控策略的NoC進(jìn)行功能驗(yàn)證和性能評(píng)估。
- Abstract:
- ?To solve the problem of Network on Chip(NoC)low efficiency based on software simulation,a FPGA based valida-tion platform construction scheme for Network on Chip(NoC)was proposed.This platform intergrates reusable modules of a traffic generation(TG),a traffic receiver(TR)and a NoC software,which are used to accomplish the function validation and performance evaluation.A NoC comprises many switching nodes was designed,and the NoC was validated by this plat-form.The experimental result shows that the speed of this platform reaches over16000times faster than software simulation;meanwhile,it can work on NoC which has different topology structure,routing algorithm and flow control strategy.
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