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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于CS5451A多路同步數(shù)據(jù)采集系統(tǒng)設(shè)計

      基于CS5451A多路同步數(shù)據(jù)采集系統(tǒng)設(shè)計

      2015-08-24 | pdf | 1150KB | 次下載 | 免費

      資料介紹

      該方案采用MPC8313為主控制器，CS5451A為模數(shù)轉(zhuǎn)換器，通過對CS5451A Master模式串口輸出時序以及FIFO讀寫時序的研究，在CPU和CS5451A之間設(shè)計了一個串并轉(zhuǎn)換模塊實現(xiàn)采樣數(shù)據(jù)的接收，數(shù)據(jù)接收后存入FIFO緩沖區(qū)，這樣解決了利用處理器SPI接口直接接收數(shù)據(jù)CPU占用率高的矛盾。
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