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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>FPGA基礎(chǔ)應(yīng)用計(jì)數(shù)器的實(shí)例詳細(xì)說明

      FPGA基礎(chǔ)應(yīng)用計(jì)數(shù)器的實(shí)例詳細(xì)說明

      2020-12-11 | rar | 0.52 MB | 次下載 | 免費(fèi)

      資料介紹

      　　最簡單的計(jì)數(shù)器

      　　最簡單有效的二進(jìn)制計(jì)數(shù)器可以由幾句Verilog 語句實(shí)現(xiàn)。比如，這是實(shí)現(xiàn)32位計(jì)數(shù)器的代碼。

      　　該計(jì)數(shù)器從0 計(jì)數(shù)到4294967295，然后回滾到0 并重新開始計(jì)數(shù)。它只需要FPGA 上一點(diǎn)點(diǎn)的資源就可以迅速完成計(jì)數(shù)，這都多虧了FPGA 中隱藏的進(jìn)位鏈。讓我們來看這種計(jì)數(shù)器的幾種變體。

      　　注意如果我們不聲明初值的話，仿真工具將不會(huì)工作，一些合成工具也有可能會(huì)改變初值，所以聲明初值是一個(gè)好主意。我們也可以用異步復(fù)位來聲明初值，但最簡單的方法還是用上面的代碼。

      　　記住FPGA 的合成工作可能得做一些處理才能使得計(jì)數(shù)器從300 開始計(jì)數(shù)。FPGA 的觸發(fā)器總是從0 開始，所以你可以認(rèn)為計(jì)數(shù)器初值必為0。但要是在邏輯電路中加入一些反相器，就可以實(shí)現(xiàn)任意的初值。逆變器在FPGA 中是“不占空間”的，所以用逆變器完全沒有缺陷。

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