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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>CPLD FPGA的快速入門學(xué)習(xí)教程免費(fèi)下載

      CPLD FPGA的快速入門學(xué)習(xí)教程免費(fèi)下載

      2021-01-25 | rar | 2.01 MB | 次下載 | 免費(fèi)

      資料介紹

      　　當(dāng)今社會(huì)，隨著電子行業(yè)的發(fā)展，大規(guī)模集成電路的運(yùn)用越來(lái)越普遍，用CPLD/FPGA來(lái)開(kāi)發(fā)新產(chǎn)品是當(dāng)前很多實(shí)際情況的需求。在此本人結(jié)合到自己的所學(xué)，利用業(yè)余時(shí)間草寫(xiě)了一個(gè)簡(jiǎn)單的使用說(shuō)明，不要求有豐富經(jīng)驗(yàn)的大蝦來(lái)駐足觀望，只希望對(duì)吾輩剛?cè)腴T的菜鳥(niǎo)們起到一個(gè)拋磚引玉的作用。由于水平有限，文中錯(cuò)誤在所難免，望各位提出寶貴的意見(jiàn)。

      　　1. 首先請(qǐng)準(zhǔn)備一套簡(jiǎn)單的CPLD 原理圖。在此我們準(zhǔn)備了如下所示的簡(jiǎn)單一個(gè)系統(tǒng)圖。晶體用 10M 的有源晶體，可以在線下載的JTAG 接口。電源用5 轉(zhuǎn)3.3V 的電源模塊AS1117。1 個(gè)1K 的排阻。8 個(gè)發(fā)光管在程序運(yùn)行時(shí)輪流點(diǎn)亮。

      　　2．安裝XILINX 的集成編譯軟件ISE5.0 或6.0。因?yàn)镮SE 在運(yùn)行時(shí)比較消耗計(jì)算機(jī)的內(nèi)存，所以要求計(jì)算機(jī)配置符合相關(guān)的要求，高一點(diǎn)的配置，不至于在運(yùn)行時(shí)死機(jī)。

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