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:設(shè)計(jì)了一種可應(yīng)用于國(guó)家標(biāo)準(zhǔn)AVS(Audio Video Coding Standard)的變字長(zhǎng)解碼器，根據(jù)碼流特點(diǎn)進(jìn)行硬件模塊劃分;采用桶形移位器并行解碼，每個(gè)時(shí)鐘解一個(gè)碼字，采用Verilog語(yǔ)言進(jìn)行設(shè)計(jì)、模擬，通過(guò)了FPGA驗(yàn)證。用0.18 pinCMOS工藝庫(kù)綜合，電路規(guī)模為1.6萬(wàn)門左右，最高頻率能夠達(dá)到166MHz，可實(shí)時(shí)解碼72帥/10801高清AVS碼流。
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