資料介紹
在使用 FPGA 過(guò)程中,通常需要對(duì)資源做出評(píng)估,下面簡(jiǎn)單談?wù)勅绾卧u(píng)估 FPGA 的資源。 FF 和 LUT 的數(shù)目:這個(gè)在寫(xiě)出具體代碼之前,初學(xué)者通常沒(méi)法估算,但資深 FPGA 工程師會(huì)估算出一個(gè)數(shù)量級(jí)。通常的做法是系統(tǒng)架構(gòu)劃分好后可以復(fù)用的模塊根據(jù)以前設(shè)計(jì)中的資源消耗數(shù)來(lái)估,新的模塊寫(xiě)完代碼后估。 RAM:這塊在實(shí)現(xiàn)架構(gòu)定好后,基本能準(zhǔn)確地估出來(lái),各個(gè)模塊需要用到幾個(gè) FIFO,幾個(gè) RAM,最終整個(gè)系統(tǒng)的 RAM 數(shù)量可以確定。前提是所有功能的實(shí)現(xiàn)方式設(shè)計(jì)好。乘法器:這個(gè)與上面 RAM 的估法一致。鎖相環(huán),時(shí)鐘分配器,時(shí)鐘資源:這部分在系統(tǒng)設(shè)計(jì)架構(gòu)完成后,根據(jù)各個(gè)模塊的時(shí)鐘頻率來(lái)確定。 IO 管腳數(shù)目:這部分其實(shí)是和需求強(qiáng)相關(guān)的,基本上需求確定好,實(shí)現(xiàn)方式確定好。特殊 IO:這部分的估算有時(shí)候和硬件接口相關(guān),有時(shí)候和實(shí)現(xiàn)方式相關(guān)。舉例來(lái)說(shuō),LVDS 的數(shù)目通常由對(duì)接的硬件器件確定,而 DDR 部分需要根據(jù)系統(tǒng)實(shí)現(xiàn)方式來(lái)確定,確定 DDR 的帶寬,頻率,接口的位寬等,這樣對(duì) DDR IP CORE 的需求也就出來(lái)了??傊?,在經(jīng)驗(yàn)不足的情況下更常用的做法是現(xiàn)在一塊比較大的開(kāi)發(fā)板上實(shí)現(xiàn)主要功能,然后在綜合工具上綜合后,直接看資源。
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