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本白皮書介紹了將 MATLAB® 算法和 Simulink® 模型直接轉(zhuǎn)換為適用于 FPGA 的 HDL 的工作 流程，內(nèi)容包括： • 使用 MATLAB 和 5G Toolbox™ 進(jìn)行符合 5G NR 標(biāo)準(zhǔn)的算法建模 • 從基于幀的 MATLAB 算法過渡到數(shù)據(jù)流的 Simulink 實(shí)現(xiàn) • 基于 Fixed-Point Designer™ 和目標(biāo)硬件特性的定點(diǎn)實(shí)現(xiàn) • 通過使用經(jīng)過驗(yàn)證的知識(shí)產(chǎn)權(quán) (IP) 加速設(shè)計(jì) • 生成 HDL 并在目標(biāo)硬件上部署，在本例中為 Xilinx® Zynq® 設(shè)備
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