資料介紹
本文設計了 CPU( ZSP_NEO )和內部存儲器的接口電路,這個接口電路同時提供一
個接口滿足DMA 對內部存儲器的訪問,并完成模塊驗證。
本設計中使用了兩個 IP:ZSP_NEO 處理器核,以及Artisan 提供的SMIC 的 0.18μm
工藝的存儲器模塊,分別研究了他們的相關功能和相關接口,主要包括:讀寫功能、讀寫時序、控制信號等。同時,也根據(jù)存儲器的情況選擇了一個合適的直接存儲器存?。―MA,Direct Memory Access)的操作協(xié)議。
本設計中主要涉及系統(tǒng)級設計( SoC )的一些相關知識、IP 的運用、Verilog 代碼的
編寫,及系統(tǒng)驗證等。
個接口滿足DMA 對內部存儲器的訪問,并完成模塊驗證。
本設計中使用了兩個 IP:ZSP_NEO 處理器核,以及Artisan 提供的SMIC 的 0.18μm
工藝的存儲器模塊,分別研究了他們的相關功能和相關接口,主要包括:讀寫功能、讀寫時序、控制信號等。同時,也根據(jù)存儲器的情況選擇了一個合適的直接存儲器存?。―MA,Direct Memory Access)的操作協(xié)議。
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