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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>數(shù)字信號處理論文>存儲陣列中的串擾分析及脈沖產(chǎn)生電路設計

      存儲陣列中的串擾分析及脈沖產(chǎn)生電路設計

      2010-05-10 | rar | 157 | 次下載 | 3積分

      資料介紹

      摘要：在SRAM存儲陣列的設計中，經(jīng)常會遇到相鄰信號線與電路節(jié)點間耦合引起的串擾問題。針對這個問題給出位線“間隔譯碼”的組織結(jié)構(gòu)，有效地降低了存儲器讀寫時寄生RC所帶來的串擾。同時，針對該“間隔譯碼”的存儲陣列結(jié)構(gòu)，設計了脈沖產(chǎn)生電路，該電路只需要利用行地址的變化來生成充電脈沖，不僅簡化了電路的規(guī)模，而且減小了讀寫操作時存儲陣列中單元之間的串擾，提高了可靠性。
      關(guān)鍵詞：耦合；間隔譯碼；串擾；SRAM
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