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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>嵌入式技術(shù)論文>基于FPGA的SDX總線與Wishbone總線接口設(shè)計(jì)

      基于FPGA的SDX總線與Wishbone總線接口設(shè)計(jì)

      2012-01-11 | pdf | 681 KB | 次下載 | 免費(fèi)

      資料介紹

      介紹了基于硬件描述語言Verilog HDL設(shè)計(jì)的SDX總線與Wishbone總線接口轉(zhuǎn)化的設(shè)計(jì)與實(shí)現(xiàn),并通過Modelsim進(jìn)行功能仿真,在QuartusⅡ軟件平臺上綜合,最終在Altera公司的CycloneⅢ系列FPGA上調(diào)試。實(shí)驗(yàn)證明了設(shè)計(jì)的可行性。

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