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網(wǎng)絡(luò)之間互連的協(xié)議也就是為計(jì)算機(jī)網(wǎng)絡(luò)相互連接進(jìn)行通信而設(shè)計(jì)的協(xié)議。在因特網(wǎng)中,它是能使連接到網(wǎng)上的所有計(jì)算機(jī)網(wǎng)絡(luò)實(shí)現(xiàn)相互通信的一套規(guī)則,規(guī)定了計(jì)算機(jī)在因特網(wǎng)上進(jìn)行通信時(shí)應(yīng)當(dāng)遵守的規(guī)則。
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Xylon在Embedded World 2015上使用MicroZed套件演示了面部檢測(cè)C可調(diào)用RTL IP
使用iVeia視覺套件進(jìn)行Canny邊緣檢測(cè)HLS IP
iVeia使用嵌入式世界2015中的iVeia視覺套件演示了Canny邊緣檢測(cè)HLS IP
了解Xilinx。 我們是全球領(lǐng)先的All Programmable FPGA,SoC和3D IC供應(yīng)商。
了解如何使用Vivado在設(shè)備啟動(dòng)時(shí)及其周??圍進(jìn)行調(diào)試。 你也會(huì)學(xué)習(xí) 使用Vivado 2014.1中引入的Trigger at Startup功...
如何使用Vivado IP Integrator組裝具有多個(gè)時(shí)鐘域的設(shè)計(jì)
該視頻演示了如何使用Vivado IP Integrator組裝具有多個(gè)時(shí)鐘域的設(shè)計(jì)。 它顯示了Vivado中的設(shè)計(jì)規(guī)則檢查和功能如何幫助用戶自動(dòng)執(zhí)行此流程。
BarcoSilex的IP核心營銷經(jīng)理Gregory Baudet在NAB 2014上討論了他們的4K視頻IP和JPEG2000壓縮演示。
Xilinx的HDMI 1.4Tx/Rx和HDMI 2.0Tx/Rx的IP內(nèi)核介紹
Xilinx的HDMI 1.4 Tx / Rx和HDMI 2.0 Tx / Rx的IP內(nèi)核將采用最新發(fā)布的inrevium AMERICA FMC HD...
intoPIX TICO夾層壓縮提供高達(dá)4:1的視覺無損壓縮,并在使用Xilinx HDMI IP內(nèi)核的KC705 Kintex-7評(píng)估平臺(tái)上進(jìn)行了演示。
Xilinx Power Advantage采用KC705評(píng)估套件演示
Xilinx開始在28nm工藝技術(shù)節(jié)點(diǎn)上實(shí)現(xiàn)前所未有的功耗降低。
PCI Express IP設(shè)計(jì)的過程與仿真介紹
了解在啟用PIPE模式的情況下創(chuàng)建PCI Express IP設(shè)計(jì)的過程,以便可以使用Mentor Graphics Questa Verificati...
此演示展示了Xilinx的400GE解決方案,該解決方案采用Xilinx Virtex UltraScale VU190器件,預(yù)先標(biāo)準(zhǔn)的400GE MA...
如何使用Vivado功能創(chuàng)建AXI外設(shè)
了解如何使用Vivado的創(chuàng)建和封裝IP功能創(chuàng)建可添加自定義邏輯的AXI外設(shè),以創(chuàng)建自定義IP。
如何使用Vivado Logic Analyzer與邏輯調(diào)試IP進(jìn)行交互
了解Vivado中的Logic Debug功能,如何將邏輯調(diào)試IP添加到設(shè)計(jì)中,以及如何使用Vivado Logic Analyzer與邏輯調(diào)試IP進(jìn)行交互。
Virtex-7 VC709連接功能套件的特點(diǎn)及應(yīng)用介紹
觀看Virtex?-7 FPGA VC709連接功能套件,這是一款40Gb / s平臺(tái),適用于高帶寬和高性能應(yīng)用,包含所有必要的硬件,工具和IP,可在開...
如何將IP模塊整合到System Generator for DSP中
了解如何將Vivado HLS設(shè)計(jì)作為IP模塊整合到System Generator for DSP中。 了解如何將Vivado HLS設(shè)計(jì)保存為IP...
訪問集成Xilinx模數(shù)轉(zhuǎn)換器的三種方法介紹
了解訪問集成Xilinx模數(shù)轉(zhuǎn)換器(XADC)的三種方法; 通過直接連接到PS,作為PS或Microblaze的AXI外設(shè),或作為邏輯的IP核。
2018-11-20 標(biāo)簽:賽靈思ip模數(shù)轉(zhuǎn)換器 2712 0
Zynq-7000 AP SoC ZC702評(píng)估套件的特點(diǎn)與應(yīng)用
Zynq-7000 All Programmable SoC評(píng)估套件ZC702簡介使設(shè)計(jì)人員能夠快速評(píng)估Zynq-7000技術(shù),同時(shí)通過其可擴(kuò)展性開發(fā)大...
Vivado Design Suite 2016.1的新功能介紹
了解Vivado Design Suite 2016中的新功能。 我們將回顧新的UltraFast方法檢查,HDL模塊參考流程和用于IPI設(shè)計(jì)的Sma...
如何在Vivado Design Suite 中進(jìn)行IP加密
此視頻概述了Vivado Design Suite中的IP加密。 它涵蓋了IP加密工具流程,如何準(zhǔn)備加密IP以及如何在Vivado中運(yùn)行加密工具。
如何快速把握機(jī)器視覺的市場(chǎng)機(jī)會(huì)
網(wǎng)絡(luò)研討會(huì)將重點(diǎn)介紹Xilinx及其合作伙伴的IP核豐富套件如何通過生態(tài)系統(tǒng)使用戶能夠快速,輕松地把握在機(jī)器視覺市場(chǎng)的機(jī)會(huì)。
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