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標(biāo)簽 > xilinx
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級功能的IP(Intellectual Property)核。
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AMD-Xilinx FPGA功耗優(yōu)化設(shè)計(jì)簡介
對于FPGA來說,設(shè)計(jì)人員可以充分利用其可編程能力以及相關(guān)的工具來準(zhǔn)確估算功耗,然后再通過優(yōu)化技術(shù)來使FPGA和相應(yīng)的硬件設(shè)計(jì)滿足其功耗方面的要求。
Xilinx FPGA的組成部分 本文是以Xilinx Kintex UltraScale+ 系列為參考所寫,其他系列有所不同,可以參考相應(yīng)的user ...
內(nèi)嵌功能模塊主要指DLL(Delay Locked Loop)、PLL(Phase Locked Loop)、DSP和CPU等軟處理核(Soft Cor...
JESD204B接口一般用在高速的AD和DA芯片上,用于傳輸采集到的數(shù)據(jù)。該接口相比LVDS可以減少大量的IO管腳,所以正在逐步取代LVDS接口(引用w...
閑談Vitis AI|DPU在UltraScale平臺(tái)下的軟硬件流程(1)
本篇中,我想跳過一些細(xì)枝末節(jié), 先簡單介紹 AMD Xilinx Vitis AI 在 Zynq 這個(gè)硬件加速平臺(tái)下軟硬件開發(fā)的基本思路和流程,把各個(gè)開...
Xilinx-vivado的網(wǎng)表形式有edf和dcp兩個(gè)方式,兩個(gè)方式各有不同。對于仿真來說,兩者均需轉(zhuǎn)換為verilog的形式進(jìn)行仿真,只是使用的命令不同。
這個(gè)命令指定clock之間是異步關(guān)系,時(shí)序分析時(shí)會(huì)完全ignore這些clock之間的path。
約束文件是FPGA設(shè)計(jì)中不可或缺的源文件。那么如何管理好約束文件呢? 到底設(shè)置幾個(gè)約束文件? 通常情況下,設(shè)計(jì)中的約束包括時(shí)序約束和物理約束。前者包括時(shí)...
Xilinx提供的手冊《ug1144-petalinux-tools-reference-guide_chn》,該文檔有說明petalinux版本支持的...
FPGA是在PAL、PLA和CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展起來的一種更復(fù)雜的可編程邏輯器件。它是ASIC領(lǐng)域中的一種半定制電路,既解決了定制電路...
比特流是一個(gè)常用詞匯,用于描述包含F(xiàn)PGA完整內(nèi)部配置狀態(tài)的文件,包括布線、邏輯資源和IO設(shè)置。大多數(shù)現(xiàn)代FPGA都是基于SRAM的,包括Xilinx ...
如何在設(shè)計(jì)中例化和使用多個(gè)BSCANE2模塊
本文對如何在一個(gè)工程里例化和使用多個(gè)BSCANE2模塊做一個(gè)簡單說明。
利用設(shè)計(jì)網(wǎng)關(guān)的 IP 內(nèi)核在 Xilinx VCK190 評估套件上加速人工智能應(yīng)用
Xilinx 的 Versal AI Core 系列器件旨在通過使用高計(jì)算效率的 ASIC 級 AI 計(jì)算引擎和靈活的可編程結(jié)構(gòu)來解決 AI 推理的獨(dú)特...
PS部分和PL部分的上電時(shí)序是獨(dú)立的,為了防止損壞器件,器件內(nèi)部已經(jīng)進(jìn)行了隔離。
在Xilinx 7系列FPGA上兩種實(shí)現(xiàn)方式的差別
在FPGA設(shè)計(jì)開發(fā)中,很多場合會(huì)遇到同一根信號既可以是輸入信號,又可以是輸出信號,即IO類型(Verilog定義成inout)。
會(huì)議系統(tǒng)設(shè)計(jì)組成及功能
隨著疫情的出現(xiàn),線上會(huì)議的應(yīng)用越來越廣泛,相關(guān)的技術(shù)也越來越成熟,但當(dāng)前的線上會(huì)議系統(tǒng)大都基于電腦和手機(jī),便于個(gè)人使用,但由于其攝像頭拍攝方向固定,當(dāng)會(huì)...
2022-10-19 標(biāo)簽:Xilinx圖像識別會(huì)議系統(tǒng) 1829 0
首先,什么是XPM?可能很多人沒聽過也沒用過,它的全稱是Xilinx Parameterized Macros,也就是Xilinx的參數(shù)化的宏,跟原語的...
隨著HDL (Hardware Description Language,硬件描述語言)語言、綜合工具及其它相關(guān)工具的推廣,使廣大設(shè)計(jì)工程師從以往煩瑣的...
Versal HBM 設(shè)備擁有兩倍大的數(shù)據(jù)庫,并且以兩倍的速度導(dǎo)出建議。右側(cè)的實(shí)時(shí)欺詐檢測基準(zhǔn)也具有相同的相對性能。 Thompson 說,這是考慮如何...
基于FPGA圖像處理的視頻流實(shí)時(shí)處理系統(tǒng)
PYNQ-Z2 是基于 Xilinx ZYNQ-7000 FPGA 的平臺(tái),除繼承了傳統(tǒng) ZYNQ 平 臺(tái)的強(qiáng)大處理性能外,還兼容 Arduino 接口...
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