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Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級(jí)集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級(jí)功能的IP(Intellectual Property)核。
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數(shù)字設(shè)計(jì)FPGA應(yīng)用:7系列FPGA IOB
本課程以目前流行的Xilinx 7系列FPGA的開發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語言及VIVADO的應(yīng)用,并循序漸進(jìn)...
數(shù)字設(shè)計(jì)FPGA應(yīng)用:編譯軟件的安裝與使用
本課程以目前流行的Xilinx 7系列FPGA的開發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語言及VIVADO的應(yīng)用,并循序漸進(jìn)...
數(shù)字設(shè)計(jì)FPGA應(yīng)用:測試138工程
中國大學(xué)MOOC 本課程以目前流行的Xilinx 7系列FPGA的開發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語言及VIVAD...
數(shù)字設(shè)計(jì)FPGA應(yīng)用:FPGA的基本實(shí)踐
本課程以目前流行的Xilinx 7系列FPGA的開發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語言及VIVADO的應(yīng)用,并循序漸進(jìn)...
數(shù)字設(shè)計(jì)FPGA應(yīng)用:74x163回顧
本課程以目前流行的Xilinx 7系列FPGA的開發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語言及VIVADO的應(yīng)用,并循序漸進(jìn)...
基于FPGA器件的VGA顯示設(shè)計(jì)與實(shí)現(xiàn)
中國大學(xué)MOOC 本課程以目前流行的Xilinx 7系列FPGA的開發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語言及VIVAD...
FPGA的原理及電路設(shè)計(jì)應(yīng)用的講解
中國大學(xué)MOOC 本課程以目前流行的Xilinx 7系列FPGA的開發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語言及VIVAD...
一種采用像素積分單元陣列結(jié)構(gòu)的FPGA實(shí)現(xiàn)與性能分析
Adaboost 算法是Freund 和Schapire 于1995 年提出的,全稱為Adaptive Boosting。它是 Boosting 算法的...
“深化大數(shù)據(jù)、人工智能等研發(fā)應(yīng)用,培育新一代信息技術(shù)、高端裝備、生物醫(yī)藥、新能源汽車、新材料等新興產(chǎn)業(yè)集群,壯大數(shù)字經(jīng)濟(jì)。”,“打造工業(yè)互聯(lián)網(wǎng)平臺(tái),拓展...
Xilinx的四個(gè)工藝級(jí)別!Xilinx器件的訂貨編號(hào)
Spartan系列器件的性能和資源數(shù)量都遠(yuǎn)不如前面三個(gè)系列,但是勝在價(jià)格便宜,所以這個(gè)系列的器件在消費(fèi)電子、汽車電子和工業(yè)領(lǐng)域的應(yīng)用相對(duì)比較廣泛。值得一...
Xilinx高速收發(fā)器GTX/GTH的2D眼圖測量功能
隨著高速數(shù)據(jù)傳輸?shù)钠占埃琒erdes已經(jīng)成為FPGA上重要的I/O接口。而線速率也不斷的提高。更高的線速率也就帶來了更大的通道衰減影響。通常,Serde...
隨著需求的多樣化,F(xiàn)PGA的功能也進(jìn)一步的增強(qiáng)。其中,高速收發(fā)器從本來是只有高端FPGA才有的模塊,已經(jīng)變?yōu)橄鄬?duì)普及的甚至必備的功能模塊。而10G的線速...
Xilinx 7系列FPGA內(nèi)置ADC XADC獲取模擬信號(hào)
XADC內(nèi)部可以直接獲取芯片結(jié)溫和FPGA的若干供電電壓(7系列不包括VCCO),用于監(jiān)控FPGA內(nèi)部狀況。同時(shí)提供了17對(duì)差分管腳,其中一對(duì)專用的模擬...
在遠(yuǎn)程更新的時(shí)候,有時(shí)候需要雙鏡像來保護(hù)設(shè)計(jì)的穩(wěn)定性。在進(jìn)行更新設(shè)計(jì)的時(shí)候,只更新一個(gè)鏡像,另一個(gè)鏡像在部署之前就測試過沒問題并不再更新。當(dāng)更新出錯(cuò)時(shí),...
XADC模擬輸入包括專用模擬輸入VP/VN和16組復(fù)用模擬信號(hào)輸入VAUX(15:0);XADC轉(zhuǎn)換結(jié)果可以通過動(dòng)態(tài)重配接口(DRP)或者JTAG接口輸...
當(dāng)FPGA復(fù)位扇出較多時(shí) 有以下辦法可以解決
xilinx推薦盡量不復(fù)位,利用上電初始化,如果使用過程中需要復(fù)位,采用同步高復(fù)位。
利用FPGA設(shè)計(jì)工具減少設(shè)計(jì)周期時(shí)間和降低風(fēng)險(xiǎn)
推出的FPGA設(shè)計(jì)工具集搭配Zynq UltraScale+ RFSoC會(huì)提供所有生產(chǎn)用的IP以及一些通用功能的IP庫,用戶在搭建自己設(shè)計(jì)時(shí)可以用到。這...
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